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  1. 工学
  2. 発表論文(工学系)

MXコアにおける部分積剰余を用いたRSA暗号の実装(応用,組込技術とネットワークに関するワークショップETNET2009)

http://hdl.handle.net/2298/18779
http://hdl.handle.net/2298/18779
f74303db-fe2e-42a1-89f1-55b8bac53352
名前 / ファイル ライセンス アクション
110007226215.pdf 110007226215.pdf (692.2 kB)
Item type 学術雑誌論文 / Journal Article(1)
公開日 2011-05-11
タイトル
タイトル MXコアにおける部分積剰余を用いたRSA暗号の実装(応用,組込技術とネットワークに関するワークショップETNET2009)
言語
言語 jpn
キーワード
主題 MXコア, RSA暗号, SIMD, MX Core, RSA
資源タイプ
資源タイプ journal article
著者 黒木, 渉

× 黒木, 渉

WEKO 110457

en Kuroki, Wataru

ja 黒木, 渉
ISNI

ja-Kana クロキ, ワタル

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飯田, 全広

× 飯田, 全広

WEKO 110458

飯田, 全広

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末吉, 敏則

× 末吉, 敏則

WEKO 110459

末吉, 敏則

Search repository
別言語の著者 黒木, 渉

× 黒木, 渉

WEKO 110457

en Kuroki, Wataru

ja 黒木, 渉
ISNI

ja-Kana クロキ, ワタル

Search repository
飯田, 全広

× 飯田, 全広

WEKO 147018

ja 飯田, 全広
ISNI

ja-Kana イイダ, マサヒロ

en Iida, Masahiro

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Sueyoshi, Toshinori

× Sueyoshi, Toshinori

WEKO 110465

Sueyoshi, Toshinori

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内容記述
内容記述 MXコアは細粒度の演算器(PE:Prpcessing Element)を複数搭載した超並列SIMD(Single Instruction Multiple Data)型プロセッサである.MXコアは処理対象をマルチメディア処理としており,データサイズが数千ビットの多倍長整数を扱うアプリケーションの実装は想定していない.本稿では,多倍長整数演算を扱う公開鍵暗号方式の一種であるRSA暗号の暗号化処理を取り上げ,部分積剰余を用いたMXコアへの実装方法の提案と評価結果について報告する.シミュレーション結果より,鍵長2,048ビットRSA暗号の暗号化処理のスループットは1,550kbps(MXコア200MHz動作時)との結果が得られ,従来の実装手法と比較するとサイクル数は31.7%の削減,スループットは2.92倍の速度向上が得られた.
内容記述
内容記述 MX Core is a massively parallel SIMD (Single Instruction Multiple Data) type processor which have fine-grained computing units (PE: Prpcessing Element). The main target of operation in MX Core is multimedia processing. Therefore the MX core does not assume the implementation of the application that handle the multiprecision integer with several thousands bits. In this paper, we focus on the RSA encryption which is a kind of public-key crypto system with multiprecision integer arithmetic operation. Then we report the implementation method of the RSA encryption, which use the interleaved modular multiplication, and describe the evaluation result. From the simulation result, the throughput of 2,048-bit RSA encryption reaches to 1,550kbps on the MX Core that the processing frequency is 200MHz. As compared with the conventional implementation, the number of cycles is reduced by 31.7% and the throughput has improved 2.92 times.
書誌情報 情報処理学会研究報告. EMB, 組込みシステム

巻 2009, 号 22, p. 85-90, 発行年 2009-02-26
書誌レコードID
収録物識別子タイプ NCID
収録物識別子 AA12149313
権利
権利情報 一般社団法人情報処理学会
情報源(ISSN)
関連名称 09196072
フォーマット
内容記述タイプ Other
内容記述 application/pdf
形態
692188 bytes
著者版フラグ
出版タイプ VoR
日本十進分類法
主題Scheme NDC
主題 548
その他の言語のタイトル
その他のタイトル A implementation of RSA encryption using Interleaved Modular Multiplication for MX Core
タイトル(ヨミ)
その他のタイトル MXコア ニ オケル ブブンセキ ジョウヨ オ モチイタ RSA アンゴウ ノ ジッソウ : オウヨウ クミコミ ギジュツ ト ネットワーク ニ カンスル ワークショップ ETNET2009
出版者
出版者 一般社団法人情報処理学会
資源タイプ
内容記述タイプ Other
内容記述 論文(Article)
資源タイプ・ローカル
雑誌掲載論文
資源タイプ・NII
Journal Article
資源タイプ・DCMI
text
資源タイプ・ローカル表示コード
01
URL
内容記述タイプ Other
内容記述 http://ci.nii.ac.jp/naid/110007226215
コメント
本文データは学協会の許諾に基づきCiNiiから複製したものである
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Ver.1 2023-06-19 18:22:22.387614
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