WEKO3
アイテム
FPGAを用いた Latching Scaler 回路の試作
http://hdl.handle.net/2298/23437
http://hdl.handle.net/2298/234374420785d-0b85-4275-8e38-7a630d8f46de
名前 / ファイル | ライセンス | アクション |
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![]() |
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Item type | 会議発表用資料 / Presentation(1) | |||||
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公開日 | 2012-02-03 | |||||
タイトル | ||||||
タイトル | FPGAを用いた Latching Scaler 回路の試作 | |||||
言語 | ||||||
言語 | jpn | |||||
資源タイプ | ||||||
資源タイプ | conference object | |||||
著者 |
伊藤, 康彦
× 伊藤, 康彦× 今津, 節男× 長壁, 正樹× 中西, 秀哉 |
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内容記述 | ||||||
内容記述タイプ | Other | |||||
内容記述 | 平成22年度熊本大学総合技術研究会,回路・計測・制御技術分野(口頭発表)セッションIII | |||||
書誌情報 | 発行日 2011-03-18 | |||||
フォーマット | ||||||
内容記述 | application/pdf | |||||
形態 | ||||||
1981678 bytes | ||||||
著者版フラグ | ||||||
出版タイプ | AM | |||||
日本十進分類法 | ||||||
主題Scheme | NDC | |||||
主題 | 429.6 | |||||
タイトル(ヨミ) | ||||||
その他のタイトル | FPGA オ モチイタ Latching Scaler カイロ ノ シサク | |||||
出版者 | ||||||
出版者 | 熊本大学工学部技術部 | |||||
資源タイプ | ||||||
内容記述 | 発表資料 | |||||
資源タイプ・ローカル | ||||||
発表資料 | ||||||
資源タイプ・NII | ||||||
Presentation | ||||||
資源タイプ・DCMI | ||||||
text | ||||||
資源タイプ・ローカル表示コード | ||||||
05 | ||||||
URI | ||||||
http://hdl.handle.net/2298/23437 | ||||||
URL | ||||||
内容記述タイプ | Other | |||||
内容記述 | http://www.tech.eng.kumamoto-u.ac.jp/kumamoto2011/ | |||||
コメント | ||||||
所属:核融合科学研究所技術部 他 |