WEKO3
アイテム
超並列プロセッサコアにおけるPE間データ転送効率の改善
http://hdl.handle.net/2298/18778
http://hdl.handle.net/2298/1877836c4e674-454d-42cf-b0b8-36b755b6abd6
| 名前 / ファイル | ライセンス | アクション |
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110007338674.pdf (474.8 kB)
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| Item type | 学術雑誌論文 / Journal Article(1) | |||||
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| 公開日 | 2011-05-11 | |||||
| タイトル | ||||||
| タイトル | 超並列プロセッサコアにおけるPE間データ転送効率の改善 | |||||
| 言語 | ||||||
| 言語 | jpn | |||||
| 資源タイプ | ||||||
| 資源タイプ | journal article | |||||
| 著者 |
中野, 光臣
× 中野, 光臣× 弘田, 澄男× 兒玉, 章宏× 飯田, 全広× 末吉, 敏則 |
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| 別言語の著者 |
Nakano, Mitsutaka
× Nakano, Mitsutaka× Hirota, Sumio× Kodama, Akihiro× 飯田, 全広× Sueyoshi, Toshinori |
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| 内容記述 | ||||||
| 内容記述 | 多数のPE(Processing Element)を持つ並列プロセッサにおいて,PE間を接続する相互結合網は重要な構成要素であり,データ転送処理はアプリケーションの実装において性能に影響を与える.本研究では,株式会社ルネサステクノロジ社が開発したSIMD型アクセラレータであるMXコアにおいて,SIMD型およびMIMD型のPE間データ転送制御での配線構造の定式化を行う.また,データ転送問題を2つの部分問題に分け,ルーティング手法を提案し評価を行う.規則的な転送処理および複雑なデータ転送処理を用いて評価を行った結果,両制御において効果的なデータ転送制御が行えることを示す.また,複雑なデータ転送処理において,MIMD制御の転送回数はSIMD制御時より90%削減することができた. | |||||
| 内容記述 | ||||||
| 内容記述 | An interconnection network between PEs is an important component in parallel processors. The data transfer processing with it has a serious influence on the performance of applications. MX core developed by Renesas technology Corp., is a massively parallel SIMD type accelerator. We formulate the data transfer control of the MX core both of SIMD type and of MIMD type. The data transfer problem is divided into two problems, and we propose both solutions of them. Our proposals are able to perform effective data transfer control by either two types. As an evaluation result, the MIMD control was reduced the number of transfer counts by 90% from SIMD control. | |||||
| 書誌情報 |
情報処理学会研究報告. MPS, 数理モデル化と問題解決研究報告 巻 2009, 号 19, p. 5-8, 発行年 2009-02-26 |
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| 書誌レコードID | ||||||
| 収録物識別子タイプ | NCID | |||||
| 収録物識別子 | AN10505667 | |||||
| 権利 | ||||||
| 権利情報 | 一般社団法人情報処理学会 | |||||
| 情報源(ISSN) | ||||||
| 関連名称 | 09196072 | |||||
| フォーマット | ||||||
| 内容記述タイプ | Other | |||||
| 内容記述 | application/pdf | |||||
| 形態 | ||||||
| 474797 bytes | ||||||
| 著者版フラグ | ||||||
| 出版タイプ | VoR | |||||
| 日本十進分類法 | ||||||
| 主題Scheme | NDC | |||||
| 主題 | 548 | |||||
| その他の言語のタイトル | ||||||
| その他のタイトル | Improvement of data transfer efficiency between PEs in a massively parallel processor(Session 1A) | |||||
| タイトル（ヨミ） | ||||||
| その他のタイトル | チョウ ヘイレツ プロセッサ コア ニ オケル PEカン データ テンソウ コウリツ ノ カイゼン | |||||
| 出版者 | ||||||
| 出版者 | 一般社団法人情報処理学会 | |||||
| 資源タイプ | ||||||
| 内容記述タイプ | Other | |||||
| 内容記述 | 論文(Article) | |||||
| 資源タイプ・ローカル | ||||||
| 雑誌掲載論文 | ||||||
| 資源タイプ・NII | ||||||
| Journal Article | ||||||
| 資源タイプ・DCMI | ||||||
| text | ||||||
| 資源タイプ・ローカル表示コード | ||||||
| 01 | ||||||
| URL | ||||||
| 内容記述タイプ | Other | |||||
| 内容記述 | http://ci.nii.ac.jp/naid/110007338674 | |||||
| コメント | ||||||
| 本文データは学協会の許諾に基づきCiNiiから複製したものである | ||||||
